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在十月份左右，負責(zé)研究和制定PCIe傳輸協(xié)議的PCI-SIG組織宣布，正式簽發(fā)了關(guān)于PCIe6.0協(xié)議的v0.9版本草案；經(jīng)過了幾個月的修正后，就在本周PCI-SIG組織宣布PCIe 6.0規(guī)范標(biāo)準v1.0版本正式發(fā)布，宣告完工。

該協(xié)議延續(xù)了慣例，帶寬速度繼續(xù)增倍，x16下可達128GB/s(單向)，由于PCIe技術(shù)允許數(shù)據(jù)全雙工雙向流動，因此雙向總吞吐量就是256GB/s。

按計劃，標(biāo)準公布12~18個月后將有商用例子出現(xiàn)，大概就是2023年，應(yīng)該服務(wù)器平臺先上。

回到技術(shù)本身，PCIe 6.0被認為是PCIe問世近20年以來變化最大的一次。坦率來說，PCIe 4.0/5.0都是對3.0的小修小改，比如依然采用基于NRZ（Non-Return-to-Zero）的128b/130b編碼。

PCIe 6.0則改用PAM4脈沖調(diào)幅信令，1b/1b編碼，單個信號就有能四種編碼（00/01/10/11）狀態(tài)，比之前翻番，允許承載最高30GHz頻率。不過，由于PAM4信號比NRZ脆弱，所以配套上馬了FEC前向糾錯機制，糾正鏈路中的信號錯誤，保障數(shù)據(jù)完整性。

除了PAM4和FEC，PCIe 6.0的最后一項主要技術(shù)就是在邏輯層使用FLIT（流量控制單元）編碼。其實，PAM4、FLIT都不算新技術(shù)，在200G+的超高速以太網(wǎng)早已應(yīng)用，其中PAM4沒能大規(guī)模推廣的原因在于物理層成本太高。另外，PCIe 6.0依然保持了向下兼容。

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關(guān)鍵詞： PCIe 6.0